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题名/责任者:

高级HDL综合和SoC原型设计/(印)瓦伊巴夫·塔拉特著 魏东，孙健译

出版发行项:

北京:科学出版社,2025

ISBN及定价:

978-7-03-080188-3/CNY78.00

载体形态项:

12,255页;26cm

并列正题名:

Advanced HDL synthesis and SOC prototyping: RTL design using Verilog

丛编项:

数字IC设计工程师丛书

个人责任者:

(印) 塔拉特 著

个人次要责任者:

魏东 译

个人次要责任者:

孙健 译

学科主题:

集成电路-芯片-设计

中图法分类号:

TN402

提要文摘附注:

本书共16章，内容包括：概述、SoC设计、RTL设计指南、RTL设计和验证、处理器设计和架构设计、SoC设计中的总线和协议、存储器和存储控制器、DSP算法与视频处理、ASIC和FPGA综合、静态时序分析、SoC原型设计、SoC原型设计指南、设计集成与SoC综合、互连线延迟和时序、SoC原型设计和调试技巧、板级测试。

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