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• 200 1_ |a 基于FPGA的数字逻辑系统实验教程 |A ji yu FPGA de shu zi luo ji xi tong shi yan jiao cheng |b 专著 |f 覃昊洁，林水生，阎波编著

• 205 __ |a 2版

• 210 __ |a 成都 |c 电子科技大学出版社 |d 2025

• 215 __ |a 365页 |c 图 |d 26cm

• 300 __ |a 新工科·高质量教材建设计划

• 330 __ |a 本书以业内使用较广泛的FPGA芯片作为目标器件，以Verilog硬件描述语言作为设计语言，选取Intel-FPGA的DE1-SoC作为实验下板验证平台。全书共8章，内容包括：实验硬件开发平台、开发环境、Verilog HDL设计的抽象级别与层次、Verilog HDL有限状态机设计等。

• 606 0_ |a 数字逻辑 |x 实验 |j 教材

• 606 0_ |a 数字系统 |x 实验 |j 教材

• 690 __ |a TP302.2-33 |v 5

• 690 __ |a TP271-33 |v 5

• 701 _0 |a 覃昊洁 |A qin hao jie |4 编著

• 701 _0 |a 林水生 |A lin shui sheng |4 编著

• 701 _0 |a 阎波 |A yan bo |4 编著

• 801 _2 |a CN |b 58marc.cn |c 20250315